From 76b75d8999b08c97765697f86bcff0fb5f0cf86b Mon Sep 17 00:00:00 2001
From: pjht <redterp@hotmail.com>
Date: Sun, 31 Jul 2016 14:27:04 -0500
Subject: [PATCH] stuff

---
 comp(old)/in_to_out            |    1 -
 {comp(old) => comp}/asm.rb     |    0
 {comp(old) => comp}/comp.circ  |    0
 {comp(old) => comp}/inc.asm    |    0
 {comp(old) => comp}/inc.code   |    0
 {comp(old) => comp}/inc.data   |    0
 {comp(old) => comp}/sim.rb     |    0
 multicycle cpu/cpu ins set.txt |   41 +-
 multicycle/multicycle.circ     | 1724 ++++++++++++++++----------------
 9 files changed, 893 insertions(+), 873 deletions(-)
 delete mode 100644 comp(old)/in_to_out
 rename {comp(old) => comp}/asm.rb (100%)
 rename {comp(old) => comp}/comp.circ (100%)
 rename {comp(old) => comp}/inc.asm (100%)
 rename {comp(old) => comp}/inc.code (100%)
 rename {comp(old) => comp}/inc.data (100%)
 rename {comp(old) => comp}/sim.rb (100%)

diff --git a/comp(old)/in_to_out b/comp(old)/in_to_out
deleted file mode 100644
index 2754595..0000000
--- a/comp(old)/in_to_out
+++ /dev/null
@@ -1 +0,0 @@
-v2.0 raw
diff --git a/comp(old)/asm.rb b/comp/asm.rb
similarity index 100%
rename from comp(old)/asm.rb
rename to comp/asm.rb
diff --git a/comp(old)/comp.circ b/comp/comp.circ
similarity index 100%
rename from comp(old)/comp.circ
rename to comp/comp.circ
diff --git a/comp(old)/inc.asm b/comp/inc.asm
similarity index 100%
rename from comp(old)/inc.asm
rename to comp/inc.asm
diff --git a/comp(old)/inc.code b/comp/inc.code
similarity index 100%
rename from comp(old)/inc.code
rename to comp/inc.code
diff --git a/comp(old)/inc.data b/comp/inc.data
similarity index 100%
rename from comp(old)/inc.data
rename to comp/inc.data
diff --git a/comp(old)/sim.rb b/comp/sim.rb
similarity index 100%
rename from comp(old)/sim.rb
rename to comp/sim.rb
diff --git a/multicycle cpu/cpu ins set.txt b/multicycle cpu/cpu ins set.txt
index 401a2e6..cbef31d 100644
--- a/multicycle cpu/cpu ins set.txt	
+++ b/multicycle cpu/cpu ins set.txt	
@@ -1,27 +1,14 @@
-0 = lda
-
-1 = ldb
-
-2 = ldai
-
-3 = ldbi
-
-4 = add
-
-5 = sub
-
-6 = mult
-
-7 = div
-
-8 = sta
-
-9 = stb
-
-a = str
-
-b = jmp
-
-c = jmpc
-
-d = jmpz
\ No newline at end of file
+0=lda
+1=ldb
+2=ldai
+3=ldbi
+4=add
+5=sub
+6=mult
+7=div
+8=sta
+9=stb
+a=str
+b=jmp
+c=jmpc
+d=jmpz
\ No newline at end of file
diff --git a/multicycle/multicycle.circ b/multicycle/multicycle.circ
index edbda53..addd2d9 100644
--- a/multicycle/multicycle.circ
+++ b/multicycle/multicycle.circ
@@ -87,8 +87,8 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
   </options>
   <mappings>
     <tool lib="6" map="Button2" name="Menu Tool"/>
-    <tool lib="6" map="Button3" name="Menu Tool"/>
     <tool lib="6" map="Ctrl Button1" name="Menu Tool"/>
+    <tool lib="6" map="Button3" name="Menu Tool"/>
   </mappings>
   <toolbar>
     <tool lib="6" name="Poke Tool"/>
@@ -128,12 +128,12 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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+    <wire from="(270,400)" to="(270,410)"/>
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@@ -143,14 +143,15 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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@@ -160,16 +161,16 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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@@ -183,14 +184,16 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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-    <wire from="(570,380)" to="(570,500)"/>
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@@ -206,8 +209,10 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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+    <wire from="(260,540)" to="(260,700)"/>
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@@ -217,30 +222,128 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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-    <wire from="(310,90)" to="(340,90)"/>
+    <wire from="(300,620)" to="(340,620)"/>
     <wire from="(600,190)" to="(610,190)"/>
+    <wire from="(310,90)" to="(340,90)"/>
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     <wire from="(70,90)" to="(100,90)"/>
     <wire from="(280,370)" to="(300,370)"/>
     <wire from="(680,350)" to="(680,380)"/>
     <wire from="(280,380)" to="(290,380)"/>
     <wire from="(670,470)" to="(670,490)"/>
-    <wire from="(130,760)" to="(570,760)"/>
     <wire from="(130,110)" to="(130,120)"/>
+    <wire from="(230,540)" to="(260,540)"/>
+    <comp lib="6" loc="(461,585)" name="Text">
+      <a name="text" val="0-Fetch instruction byte 1"/>
+    </comp>
+    <comp lib="6" loc="(418,632)" name="Text">
+      <a name="text" val="3-Execute"/>
+    </comp>
+    <comp lib="0" loc="(250,170)" name="Constant">
+      <a name="width" val="16"/>
+    </comp>
+    <comp lib="5" loc="(260,70)" name="Hex Digit Display"/>
+    <comp lib="4" loc="(750,310)" name="RAM">
+      <a name="addrWidth" val="12"/>
+      <a name="bus" val="separate"/>
+    </comp>
+    <comp lib="5" loc="(70,70)" name="Hex Digit Display"/>
+    <comp lib="0" loc="(340,660)" name="Probe">
+      <a name="facing" val="west"/>
+      <a name="radix" val="16"/>
+      <a name="label" val="ADDR"/>
+      <a name="labelloc" val="east"/>
+    </comp>
+    <comp lib="1" loc="(690,480)" name="NOT Gate"/>
+    <comp lib="0" loc="(340,640)" name="Probe">
+      <a name="facing" val="west"/>
+      <a name="radix" val="16"/>
+      <a name="label" val="INS"/>
+      <a name="labelloc" val="east"/>
+    </comp>
+    <comp lib="5" loc="(300,70)" name="Hex Digit Display"/>
+    <comp lib="1" loc="(690,360)" name="NOT Gate"/>
+    <comp lib="5" loc="(340,70)" name="Hex Digit Display"/>
+    <comp lib="5" loc="(190,70)" name="Hex Digit Display"/>
+    <comp lib="6" loc="(461,600)" name="Text">
+      <a name="text" val="1-Fetch instruction byte 2"/>
+    </comp>
+    <comp lib="0" loc="(340,700)" name="Probe">
+      <a name="facing" val="west"/>
+      <a name="radix" val="16"/>
+      <a name="label" val="PHASE"/>
+      <a name="labelloc" val="east"/>
+    </comp>
+    <comp lib="0" loc="(340,600)" name="Probe">
+      <a name="facing" val="west"/>
+      <a name="radix" val="16"/>
+      <a name="label" val="C"/>
+      <a name="labelloc" val="east"/>
+    </comp>
+    <comp lib="6" loc="(461,617)" name="Text">
+      <a name="text" val="2-Fetch instruction byte 3"/>
+    </comp>
+    <comp lib="0" loc="(340,580)" name="Probe">
+      <a name="facing" val="west"/>
+      <a name="radix" val="16"/>
+      <a name="label" val="B"/>
+      <a name="labelloc" val="east"/>
+    </comp>
+    <comp loc="(230,440)" name="CPU"/>
+    <comp lib="5" loc="(120,200)" name="Button">
+      <a name="label" val="Reset"/>
+      <a name="labelloc" val="west"/>
+    </comp>
+    <comp lib="0" loc="(340,620)" name="Probe">
+      <a name="facing" val="west"/>
+      <a name="radix" val="16"/>
+      <a name="label" val="D"/>
+      <a name="labelloc" val="east"/>
+    </comp>
+    <comp lib="4" loc="(750,190)" name="ROM">
+      <a name="addrWidth" val="12"/>
+      <a name="contents">addr/data: 12 8
+5 a 0 9 10
+</a>
+    </comp>
+    <comp lib="4" loc="(750,430)" name="RAM">
+      <a name="addrWidth" val="12"/>
+      <a name="bus" val="separate"/>
+    </comp>
+    <comp lib="5" loc="(400,200)" name="LED">
+      <a name="label" val="ROM Write Error"/>
+      <a name="labelloc" val="east"/>
+    </comp>
+    <comp lib="0" loc="(340,560)" name="Probe">
+      <a name="facing" val="west"/>
+      <a name="radix" val="16"/>
+      <a name="label" val="A"/>
+      <a name="labelloc" val="east"/>
+    </comp>
+    <comp lib="0" loc="(120,110)" name="Splitter">
+      <a name="facing" val="north"/>
+      <a name="incoming" val="8"/>
+      <a name="bit1" val="0"/>
+      <a name="bit2" val="0"/>
+      <a name="bit3" val="0"/>
+      <a name="bit4" val="1"/>
+      <a name="bit5" val="1"/>
+      <a name="bit6" val="1"/>
+      <a name="bit7" val="1"/>
+    </comp>
     <comp lib="0" loc="(320,110)" name="Splitter">
       <a name="facing" val="north"/>
       <a name="fanout" val="4"/>
@@ -261,96 +364,16 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
       <a name="bit14" val="3"/>
       <a name="bit15" val="3"/>
     </comp>
-    <comp lib="4" loc="(750,310)" name="RAM">
-      <a name="addrWidth" val="12"/>
-      <a name="bus" val="separate"/>
-    </comp>
-    <comp lib="0" loc="(550,500)" name="Clock"/>
-    <comp lib="0" loc="(340,600)" name="Probe">
-      <a name="facing" val="west"/>
-      <a name="radix" val="16"/>
-      <a name="label" val="C"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp loc="(230,440)" name="CPU"/>
+    <comp loc="(280,200)" name="RAM/ROM Decoder"/>
+    <comp lib="0" loc="(760,110)" name="Pull Resistor"/>
     <comp lib="0" loc="(340,680)" name="Probe">
       <a name="facing" val="west"/>
       <a name="radix" val="16"/>
       <a name="label" val="PC"/>
       <a name="labelloc" val="east"/>
     </comp>
-    <comp lib="0" loc="(340,620)" name="Probe">
-      <a name="facing" val="west"/>
-      <a name="radix" val="16"/>
-      <a name="label" val="D"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="5" loc="(300,70)" name="Hex Digit Display"/>
-    <comp lib="5" loc="(260,70)" name="Hex Digit Display"/>
-    <comp lib="0" loc="(340,640)" name="Probe">
-      <a name="facing" val="west"/>
-      <a name="radix" val="16"/>
-      <a name="label" val="INS"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(250,170)" name="Constant">
-      <a name="width" val="16"/>
-    </comp>
-    <comp lib="0" loc="(120,110)" name="Splitter">
-      <a name="facing" val="north"/>
-      <a name="incoming" val="8"/>
-      <a name="bit1" val="0"/>
-      <a name="bit2" val="0"/>
-      <a name="bit3" val="0"/>
-      <a name="bit4" val="1"/>
-      <a name="bit5" val="1"/>
-      <a name="bit6" val="1"/>
-      <a name="bit7" val="1"/>
-    </comp>
     <comp lib="5" loc="(110,70)" name="Hex Digit Display"/>
-    <comp lib="5" loc="(340,70)" name="Hex Digit Display"/>
-    <comp lib="0" loc="(340,660)" name="Probe">
-      <a name="facing" val="west"/>
-      <a name="radix" val="16"/>
-      <a name="label" val="ADDR"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(340,580)" name="Probe">
-      <a name="facing" val="west"/>
-      <a name="radix" val="16"/>
-      <a name="label" val="B"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(760,110)" name="Pull Resistor"/>
-    <comp lib="5" loc="(400,200)" name="LED">
-      <a name="label" val="ROM Write Error"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="5" loc="(190,70)" name="Hex Digit Display"/>
-    <comp lib="1" loc="(690,360)" name="NOT Gate"/>
-    <comp lib="4" loc="(750,430)" name="RAM">
-      <a name="addrWidth" val="12"/>
-      <a name="bus" val="separate"/>
-    </comp>
-    <comp lib="0" loc="(340,560)" name="Probe">
-      <a name="facing" val="west"/>
-      <a name="radix" val="16"/>
-      <a name="label" val="A"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="5" loc="(120,200)" name="Button">
-      <a name="label" val="Reset"/>
-      <a name="labelloc" val="west"/>
-    </comp>
-    <comp lib="4" loc="(750,190)" name="ROM">
-      <a name="addrWidth" val="12"/>
-      <a name="contents">addr/data: 12 8
-5 a 0 13 1
-</a>
-    </comp>
-    <comp lib="5" loc="(70,70)" name="Hex Digit Display"/>
-    <comp loc="(280,200)" name="RAM/ROM Decoder"/>
-    <comp lib="1" loc="(690,480)" name="NOT Gate"/>
+    <comp lib="0" loc="(550,500)" name="Clock"/>
   </circuit>
   <circuit name="RAM/ROM Decoder">
     <a name="circuit" val="RAM/ROM Decoder"/>
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+      <a name="label" val="addr"/>
+    </comp>
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-      <a name="size" val="30"/>
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-    <comp lib="1" loc="(610,420)" name="AND Gate">
-      <a name="size" val="30"/>
-      <a name="inputs" val="3"/>
-    </comp>
-    <comp lib="0" loc="(1170,610)" name="Pin">
-      <a name="facing" val="west"/>
-      <a name="output" val="true"/>
-      <a name="label" val="b12"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="1" loc="(610,600)" name="AND Gate">
-      <a name="size" val="30"/>
-      <a name="inputs" val="3"/>
-    </comp>
-    <comp lib="1" loc="(610,510)" name="AND Gate">
-      <a name="size" val="30"/>
-      <a name="inputs" val="3"/>
-    </comp>
-    <comp lib="1" loc="(610,570)" name="AND Gate">
-      <a name="size" val="30"/>
-      <a name="inputs" val="3"/>
-    </comp>
-    <comp lib="0" loc="(1170,630)" name="Pin">
-      <a name="facing" val="west"/>
-      <a name="output" val="true"/>
-      <a name="label" val="b13"/>
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     </comp>
-    <comp lib="0" loc="(1170,370)" name="Pin">
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       <a name="facing" val="west"/>
       <a name="output" val="true"/>
-      <a name="label" val="b00"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(1170,350)" name="Pin">
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-      <a name="output" val="true"/>
-      <a name="label" val="ROM Write Error"/>
-      <a name="labelloc" val="east"/>
-    </comp>
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-    </comp>
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-      <a name="output" val="true"/>
-      <a name="label" val="b07"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(1170,430)" name="Pin">
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-      <a name="output" val="true"/>
-      <a name="label" val="b03"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(1170,670)" name="Pin">
-      <a name="facing" val="west"/>
-      <a name="output" val="true"/>
-      <a name="label" val="b15"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(130,430)" name="Pin">
-      <a name="tristate" val="false"/>
-      <a name="label" val="str"/>
-    </comp>
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-    </comp>
-    <comp lib="0" loc="(1170,530)" name="Pin">
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-    </comp>
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-      <a name="output" val="true"/>
-      <a name="label" val="b04"/>
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-    </comp>
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-    <comp lib="1" loc="(610,540)" name="AND Gate">
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-    </comp>
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-      <a name="size" val="70"/>
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-      <a name="facing" val="west"/>
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-      <a name="label" val="b02"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(1170,590)" name="Pin">
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-    </comp>
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-    </comp>
-    <comp lib="1" loc="(1170,690)" name="AND Gate">
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-    </comp>
-    <comp lib="1" loc="(610,390)" name="AND Gate">
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-    </comp>
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     </comp>
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@@ -883,33 +881,58 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
       <a name="tristate" val="false"/>
       <a name="label" val="ROM Selector"/>
     </comp>
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-    </comp>
-    <comp lib="0" loc="(1170,490)" name="Pin">
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-      <a name="output" val="true"/>
-      <a name="label" val="b06"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="1" loc="(610,630)" name="AND Gate">
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       <a name="size" val="30"/>
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     </comp>
-    <comp lib="0" loc="(1170,550)" name="Pin">
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+    </comp>
+    <comp lib="1" loc="(610,180)" name="AND Gate">
+      <a name="size" val="30"/>
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+    </comp>
+    <comp lib="1" loc="(610,360)" name="AND Gate">
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+    </comp>
+    <comp lib="1" loc="(610,210)" name="AND Gate">
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+    </comp>
+    <comp lib="0" loc="(1170,510)" name="Pin">
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+    </comp>
   </circuit>
   <circuit name="CPU">
     <a name="circuit" val="CPU"/>
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+      <rect fill="none" height="120" stroke="#000000" stroke-width="2" width="70" x="50" y="50"/>
       <text font-family="SansSerif" font-size="12" text-anchor="middle" x="64" y="65">DIN</text>
       <text font-family="SansSerif" font-size="12" text-anchor="middle" x="99" y="75">DOUT</text>
       <text font-family="SansSerif" font-size="12" text-anchor="middle" x="99" y="65">ADDR</text>
@@ -931,6 +954,7 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
       <text font-family="SansSerif" font-size="12" text-anchor="middle" x="106" y="134">INS</text>
       <text font-family="SansSerif" font-size="12" text-anchor="middle" x="99" y="145">ADDR</text>
       <text font-family="SansSerif" font-size="12" text-anchor="middle" x="106" y="155">PC</text>
+      <text font-family="SansSerif" font-size="12" text-anchor="middle" x="96" y="165">PHASE</text>
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@@ -944,6 +968,7 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
       <circ-port height="8" pin="120,100" width="8" x="46" y="76"/>
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     </appear>
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-      <a name="label" val="Data In"/>
-    </comp>
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-    </comp>
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     </comp>
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     </comp>
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     </comp>
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+    </comp>
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+    </comp>
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-      <a name="width" val="3"/>
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-    <comp lib="0" loc="(120,100)" name="Pin">
-      <a name="tristate" val="false"/>
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-    </comp>
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-      <a name="bit23" val="0"/>
-    </comp>
-    <comp lib="4" loc="(760,330)" name="Register"/>
-    <comp lib="4" loc="(760,400)" name="Register"/>
-    <comp lib="3" loc="(400,350)" name="Comparator">
-      <a name="width" val="3"/>
-      <a name="mode" val="unsigned"/>
-    </comp>
-    <comp lib="0" loc="(360,420)" name="Constant">
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-    <comp lib="3" loc="(400,410)" name="Comparator">
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-    </comp>
-    <comp lib="0" loc="(930,210)" name="Pull Resistor"/>
-    <comp lib="4" loc="(160,160)" name="Register"/>
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-      <a name="facing" val="west"/>
-      <a name="output" val="true"/>
-      <a name="width" val="8"/>
-      <a name="label" val="INS"/>
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-    </comp>
-    <comp lib="0" loc="(360,360)" name="Constant">
-      <a name="width" val="3"/>
-      <a name="value" val="0x2"/>
-    </comp>
-    <comp lib="4" loc="(160,230)" name="Register"/>
-    <comp lib="0" loc="(360,300)" name="Constant">
-      <a name="width" val="3"/>
-    </comp>
-    <comp lib="0" loc="(1020,80)" name="Pin">
-      <a name="facing" val="west"/>
-      <a name="output" val="true"/>
-      <a name="width" val="8"/>
-      <a name="label" val="C"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="1" loc="(670,240)" name="OR Gate">
-      <a name="size" val="30"/>
-      <a name="inputs" val="2"/>
-    </comp>
-    <comp lib="0" loc="(1020,190)" name="Pin">
-      <a name="facing" val="west"/>
-      <a name="output" val="true"/>
-      <a name="width" val="16"/>
-      <a name="label" val="PC"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp loc="(570,380)" name="Ins Dec"/>
-    <comp lib="4" loc="(760,470)" name="Register"/>
-    <comp lib="0" loc="(480,90)" name="Pin">
-      <a name="facing" val="west"/>
-      <a name="output" val="true"/>
-      <a name="width" val="8"/>
-      <a name="label" val="Data Out"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(360,250)" name="Constant">
-      <a name="width" val="3"/>
-      <a name="value" val="0x0"/>
-    </comp>
-    <comp lib="4" loc="(760,260)" name="Register"/>
     <comp lib="3" loc="(400,240)" name="Comparator">
       <a name="width" val="3"/>
       <a name="mode" val="unsigned"/>
@@ -1477,21 +1402,9 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
       <a name="label" val="Addr"/>
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     </comp>
-    <comp lib="2" loc="(450,60)" name="Multiplexer">
-      <a name="width" val="16"/>
-      <a name="disabled" val="0"/>
-      <a name="enable" val="false"/>
-    </comp>
-    <comp lib="2" loc="(610,600)" name="Decoder">
-      <a name="select" val="2"/>
-      <a name="disabled" val="0"/>
-    </comp>
-    <comp lib="0" loc="(1020,40)" name="Pin">
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-      <a name="output" val="true"/>
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-      <a name="label" val="A"/>
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+      <a name="label" val="Phase"/>
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+    <comp lib="2" loc="(650,330)" name="Multiplexer">
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     </comp>
+    <comp lib="4" loc="(260,80)" name="Register">
+      <a name="width" val="24"/>
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+    </comp>
+    <comp lib="1" loc="(250,260)" name="OR Gate">
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     </comp>
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     </comp>
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-    </comp>
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     </comp>
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     </comp>
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@@ -1931,58 +1935,156 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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@@ -1990,13 +2092,9 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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@@ -2004,96 +2102,10 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
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-    <comp lib="1" loc="(630,900)" name="OR Gate">
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@@ -2101,36 +2113,58 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
       <a name="label" val="M/I/A/R"/>
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     </comp>
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     </comp>
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+      <a name="value" val="0x3"/>
+    </comp>
+    <comp lib="0" loc="(810,460)" name="Pull Resistor"/>
+    <comp lib="0" loc="(960,520)" name="Pin">
+      <a name="facing" val="west"/>
+      <a name="output" val="true"/>
+      <a name="label" val="JMP"/>
+      <a name="labelloc" val="east"/>
+    </comp>
+    <comp lib="1" loc="(650,670)" name="OR Gate">
+      <a name="inputs" val="4"/>
+    </comp>
+    <comp lib="1" loc="(470,390)" name="OR Gate">
+      <a name="size" val="30"/>
+      <a name="inputs" val="2"/>
+    </comp>
+    <comp lib="3" loc="(260,400)" name="Comparator">
+      <a name="mode" val="unsigned"/>
+    </comp>
+    <comp lib="3" loc="(260,1240)" name="Comparator">
+      <a name="mode" val="unsigned"/>
+    </comp>
+    <comp lib="3" loc="(260,1000)" name="Comparator">
+      <a name="mode" val="unsigned"/>
+    </comp>
+    <comp lib="3" loc="(260,340)" name="Comparator">
+      <a name="mode" val="unsigned"/>
+    </comp>
+    <comp lib="0" loc="(220,990)" name="Constant">
+      <a name="width" val="8"/>
+      <a name="value" val="0xd"/>
+    </comp>
+    <comp lib="2" loc="(890,710)" name="Priority Encoder">
+      <a name="select" val="2"/>
+    </comp>
+    <comp lib="0" loc="(220,270)" name="Constant">
+      <a name="width" val="8"/>
+    </comp>
     <comp lib="1" loc="(150,290)" name="Controlled Buffer">
       <a name="width" val="8"/>
     </comp>
-    <comp lib="3" loc="(260,1360)" name="Comparator">
-      <a name="mode" val="unsigned"/>
-    </comp>
-    <comp lib="0" loc="(960,440)" name="Pin">
-      <a name="facing" val="west"/>
-      <a name="output" val="true"/>
-      <a name="width" val="2"/>
-      <a name="label" val="R Reg B"/>
-      <a name="labelloc" val="east"/>
-    </comp>
-    <comp lib="0" loc="(820,380)" name="Pull Resistor"/>
-    <comp lib="3" loc="(260,880)" name="Comparator">
-      <a name="mode" val="unsigned"/>
-    </comp>
-    <comp lib="0" loc="(220,1230)" name="Constant">
-      <a name="width" val="8"/>
-      <a name="value" val="0x11"/>
-    </comp>
+    <comp lib="0" loc="(350,2060)" name="Pull Resistor"/>
   </circuit>
   <circuit name="ALU">
     <a name="circuit" val="ALU"/>
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-      <a name="tristate" val="false"/>
-      <a name="label" val="OP"/>
-    </comp>
-    <comp lib="1" loc="(330,300)" name="Controlled Buffer">
-      <a name="width" val="8"/>
-    </comp>
-    <comp lib="1" loc="(330,330)" name="Controlled Buffer">
-      <a name="width" val="8"/>
-    </comp>
-    <comp lib="2" loc="(200,480)" name="Decoder">
-      <a name="select" val="3"/>
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-      <a name="enable" val="false"/>
-    </comp>
-    <comp lib="1" loc="(310,300)" name="OR Gate">
-      <a name="width" val="8"/>
-      <a name="size" val="30"/>
-      <a name="inputs" val="2"/>
-    </comp>
-    <comp lib="3" loc="(320,260)" name="Subtractor"/>
-    <comp lib="1" loc="(320,380)" name="XOR Gate">
-      <a name="width" val="8"/>
-      <a name="size" val="30"/>
-      <a name="inputs" val="2"/>
-    </comp>
-    <comp lib="1" loc="(340,380)" name="Controlled Buffer">
-      <a name="width" val="8"/>
-    </comp>
-    <comp lib="1" loc="(310,330)" name="AND Gate">
-      <a name="width" val="8"/>
-      <a name="size" val="30"/>
-      <a name="inputs" val="2"/>
-    </comp>
-    <comp lib="1" loc="(330,360)" name="Controlled Buffer">
-      <a name="width" val="8"/>
-    </comp>
-    <comp lib="0" loc="(210,230)" name="Pin">
-      <a name="width" val="8"/>
-      <a name="tristate" val="false"/>
-      <a name="label" val="A"/>
-    </comp>
-    <comp lib="1" loc="(430,200)" name="Controlled Buffer">
+    <comp lib="1" loc="(430,260)" name="Controlled Buffer">
       <a name="width" val="8"/>
     </comp>
     <comp lib="0" loc="(210,270)" name="Pin">
@@ -2254,7 +2245,16 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
       <a name="tristate" val="false"/>
       <a name="label" val="B"/>
     </comp>
-    <comp lib="1" loc="(310,360)" name="NOT Gate">
+    <comp lib="1" loc="(340,380)" name="Controlled Buffer">
+      <a name="width" val="8"/>
+    </comp>
+    <comp lib="0" loc="(210,230)" name="Pin">
+      <a name="width" val="8"/>
+      <a name="tristate" val="false"/>
+      <a name="label" val="A"/>
+    </comp>
+    <comp lib="3" loc="(320,200)" name="Adder"/>
+    <comp lib="1" loc="(430,200)" name="Controlled Buffer">
       <a name="width" val="8"/>
     </comp>
     <comp lib="0" loc="(450,300)" name="Pin">
@@ -2264,9 +2264,43 @@ This file is intended to be loaded by Logisim (http://www.cburch.com/logisim/).
       <a name="label" val="R"/>
       <a name="labelloc" val="east"/>
     </comp>
-    <comp lib="1" loc="(430,260)" name="Controlled Buffer">
+    <comp lib="1" loc="(330,330)" name="Controlled Buffer">
       <a name="width" val="8"/>
     </comp>
-    <comp lib="3" loc="(320,200)" name="Adder"/>
+    <comp lib="1" loc="(330,300)" name="Controlled Buffer">
+      <a name="width" val="8"/>
+    </comp>
+    <comp lib="3" loc="(320,260)" name="Subtractor"/>
+    <comp lib="1" loc="(310,360)" name="NOT Gate">
+      <a name="width" val="8"/>
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+    <comp lib="1" loc="(320,380)" name="XOR Gate">
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+    </comp>
+    <comp lib="1" loc="(330,360)" name="Controlled Buffer">
+      <a name="width" val="8"/>
+    </comp>
+    <comp lib="1" loc="(310,300)" name="OR Gate">
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+    <comp lib="1" loc="(310,330)" name="AND Gate">
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+    </comp>
   </circuit>
 </project>